小柚

13823456789|xiaoyou_verif@163.com|深圳市

个人总结

微电子专业应届生,专注于数字芯片验证方向。熟练掌握SystemVerilog与UVM验证方法学,具备完整的IP核验证项目经验。在校期间主导过基于RISC-V架构的SoC验证平台搭建,善于通过脚本自动化提升验证效率。期待在硬科技领域深耕,成为一名优秀的芯片验证工程师。

工作经历

数字验证实习生

大疆创新

2025-07 - 2025-10
  • 负责图像信号处理(ISP)模块中降噪子模块的功能验证,编写超过40个测试用例,覆盖边界条件及异常场景,发现并协助修复了3个深层次的逻辑时序问题。
  • 利用Python脚本自动化解析仿真日志,将回归测试的结果分析时间从每天2小时缩短至15分钟,显著提升了团队每日构建版本的验证效率。
  • 参与UVM验证环境的维护与升级,针对特定场景优化了Sequence机制,使得随机约束求解的成功率提升了约15%。

项目经历

基于RISC-V的简易SoC验证平台搭建

西安电子科技大学集成电路实验室

2024-09 - 2025-01
  • 独立搭建基于UVM方法学的验证环境,集成UART、GPIO及Timer等外设接口,实现了总线协议(APB/AHB)的完整性检查。
  • 设计并实施覆盖率驱动验证策略,代码覆盖率达成98%,功能覆盖率达成95%,确保核心逻辑无死角。
  • 编写Tcl与Shell脚本实现仿真任务的自动调度与资源管理,在有限服务器资源下将大规模回归测试的周转时间缩短了30%。

高速SerDes接口协议一致性验证

课程设计项目

2025-03 - 2025-06
  • 针对PCIe Gen3协议标准,使用SystemVerilog Assertions (SVA) 编写了50+条断言,实时监测链路训练状态机及数据包传输合规性。
  • 构建受约束的随机激励生成器,模拟各种误码注入场景,成功验证了接收端均衡器在极端信道损耗下的恢复能力。
  • 通过波形调试定位了时钟域交叉(CDC)导致的亚稳态问题,并提出增加两级同步器的解决方案,经仿真验证有效消除了数据丢失风险。

教育背景

西安电子科技大学

本科 · 微电子科学与工程

2022-09 - 2026-06

技能专长

验证语言与方法学

SystemVerilog · UVM · SVA · OOP

EDA工具

VCS · Xcelium · Verdi · Questasim

脚本与编程

Python · Tcl · Shell · C/C++

专业知识

数字电路原理 · 计算机体系结构 · AMBA总线协议 · CDC分析

简历范文入门2026/7/18

芯片验证工程师简历范文(半导体/硬科技校招)

芯片验证工程师 半导体/硬科技 应届生

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核心亮点

精准匹配半导体/硬科技校招岗位需求
突出Verilog/SystemVerilog与UVM项目实战经验
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适用人群

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