IC封装与热设计工程师简历模板（半导体封测/先进封装校招）
专为半导体封测与先进封装领域校招应届生打造的IC封装与热设计工程师简历模板。突出3DIC、TSV互连技术、热仿真分析及Sigrity、HFSS等核心工具技能，结构清晰展示项目经历与科研成果，助力电子/微电子专业毕业生高效呈现专业能力，精准匹配芯片封装、热管理岗位需求。
模板亮点
- 聚焦3DIC与TSV先进封装技术展示
- 强化热仿真与Sigrity/HFSS工具技能
- 适配校招场景的项目经历模块化布局
- 突出微电子专业背景与科研成果
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适用人群
本模板特别适合IC封装与热设计工程师岗位的求职者使用，具备应届生工作经验的专业人士， 通过工程技术类风格的设计，帮助您在半导体/集成电路 行业中脱颖而出，展现专业形象和核心竞争力。
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模板内容
小柚
个人总结
微电子专业应届生，聚焦先进封装与热管理方向。熟练掌握3DIC集成、TSV工艺及多物理场仿真，具备HFSS与Sigrity实战经验。在实习期间参与高功率芯片热设计项目，通过优化微凸点布局将结温降低8℃。追求技术深度，致力于解决高密度封装中的散热瓶颈问题。
工作经历
封装热设计实习生
长电科技
- 参与某高性能计算芯片的2.5D封装热仿真项目，利用Icepak建立包含微凸点、硅中介层及散热盖的多尺度模型，识别出局部热点区域。
- 协助资深工程师优化Underfill填充工艺参数，通过调整材料热导率与厚度，使模块整体热阻降低12%，有效缓解了翘曲风险。
- 负责整理TSV刻蚀与填充工艺的DOE实验数据，输出分析报告3份，为工艺窗口确定提供了关键数据支撑。
项目经历
3DIC堆叠结构电热协同仿真
电子科技大学微电子学院
- 针对高带宽存储器（HBM）与逻辑芯片堆叠场景，使用HFSS提取TSV阵列的寄生电感与电容，分析高频信号下的串扰特性。
- 结合Sigrity PowerDC进行电源完整性分析，发现大电流路径上的IR Drop超过5%，提出增加去耦电容密度的改进方案。
- 最终仿真结果显示，优化后的结构在10W功耗下最高温度从92℃降至84℃，且电压波动控制在±3%以内。
晶圆级封装（WLP）应力可靠性研究
电子科技大学微电子学院
- 构建Fan-Out WLP有限元模型，模拟回流焊过程中的热机械应力分布，重点关注铜柱与介电层界面的剥离风险。
- 对比不同模塑料（EMC）CTE匹配方案，筛选出应力集中系数最低的配方，预计可将疲劳寿命提升20%。
- 撰写技术论文一篇，详细阐述了RDL线宽线厚对应力缓冲的影响机制，获学院优秀课程设计奖。
教育背景
电子科技大学
本科 · 微电子科学与工程
技能专长
封装设计与仿真
3DIC集成 · TSV工艺 · Fan-Out WLP · 微凸点设计
仿真工具
ANSYS Icepak · HFSS · Sigrity PowerDC · COMSOL Multiphysics
专业知识
热 - 力耦合分析 · 信号完整性 · 电源完整性 · 可靠性测试
编程语言
Python (数据处理) · Tcl脚本 · MATLAB
证书资质
Cadence Sigrity认证工程师
Cadence Design Systems
ANSYS Icepak热仿真专项证书
ANSYS Inc.
获奖经历
全国大学生集成电路创新创业大赛二等奖
中国半导体行业协会
参赛项目《面向AI芯片的高密度TSV互连结构设计》，在决赛中获得专家高度评价。
校级优秀毕业生
电子科技大学
综合成绩排名前5%，且在科研实践方面表现突出。
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