芯片设计/验证工程师简历模板(集成电路/半导体校招)简历模板预览
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芯片设计/验证工程师简历模板(集成电路/半导体校招)

2026-07-23

专为集成电路与半导体行业应届生打造的芯片设计/验证工程师简历模板。突出Verilog/VHDL编程、FPGA开发、Cadence工具链、数字信号处理及DRC/LVS验证等核心技能。采用清晰的技术栈展示结构,帮助校招求职者精准呈现项目经历与专业能力,提升简历通过率。

模板亮点

  • 核心技能模块化展示
  • 项目经历与技术栈深度结合
  • 符合半导体行业HR筛选习惯
  • 突出校招实习与竞赛成果

相关标签

#芯片设计简历 #验证工程师模板 #集成电路校招 #半导体简历 #Verilog简历

适用人群

本模板特别适合芯片设计/验证工程师岗位的求职者使用,具备应届生工作经验的专业人士, 通过技术类风格的设计,帮助您在集成电路/半导体 行业中脱颖而出,展现专业形象和核心竞争力。

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模板内容

小柚

13800138000|xiaoyou@example.com|上海

个人总结

微电子专业应届硕士,专注于数字集成电路设计与验证。具备扎实的数电模电基础,熟练掌握Verilog HDL语言及FPGA开发流程。在校期间参与多款芯片模块的前端设计与后端验证,熟悉Cadence工具链及DRC/LVS物理验证规则。追求代码质量与系统稳定性,致力于在半导体领域深耕。

工作经历

数字IC设计实习生

紫光展锐

2025-07 - 2025-12
  • 参与低功耗蓝牙SoC中GPIO控制模块的RTL代码编写,基于Verilog实现状态机逻辑,代码覆盖率达到98%。
  • 协助 senior 工程师完成模块的功能仿真与时序收敛分析,利用ModelSim定位并修复3处潜在的亚稳态问题。
  • 负责部分物理验证工作,运行Calibre进行DRC/LVS检查,协助解决金属层密度违例问题5处,确保版图符合foundry工艺要求。

项目经历

基于RISC-V架构的处理器核设计

电子科技大学实验室

2024-09 - 2025-06
  • 独立设计并实现支持RV32IM指令集的5级流水线CPU核心,使用Verilog HDL完成数据通路与控制单元构建。
  • 搭建UVM验证环境,编写测试用例超过200个,成功覆盖所有异常中断场景,仿真通过率100%。
  • 在Xilinx Artix-7 FPGA上进行板级验证,主频达到120MHz,资源利用率控制在75%以内。

高速ADC接口数字信号处理模块

课程设计项目

2024-03 - 2024-06
  • 设计用于通信系统的数字下变频(DDC)模块,实现CIC滤波器与FIR滤波器的级联结构。
  • 优化算法位宽配置,在保证信噪比前提下将逻辑资源消耗降低15%,并通过Cadence Virtuoso完成原理图绘制。
  • 完成模块的后端布局布线指导,通过LVS验证确保网表与原理图一致性,无电气连接错误。

教育背景

电子科技大学

硕士 · 集成电路工程

2023-09 - 2026-06

西安电子科技大学

本科 · 微电子科学与工程

2019-09 - 2023-06
主修数字集成电路设计、超大规模集成电路测试技术。GPA 3.8/4.0,连续两年获得校级一等奖学金。
系统学习半导体物理、模拟/数字电路基础。毕业设计获评优秀等级,掌握基础版图绘制技能。

技能专长

设计语言与仿真

Verilog HDL · VHDL · SystemVerilog · UVM验证方法学

EDA工具链

Cadence Virtuoso · Synopsys Design Compiler · Mentor Graphics Calibre · ModelSim · Vivado

硬件开发

FPGA开发 · Xilinx/Altera平台 · PCB基础 · 逻辑分析仪调试

专业技能

数字信号处理 · DRC/LVS物理验证 · 静态时序分析(STA) · 计算机体系结构

证书资质

英语六级(CET-6)

教育部考试中心

2023-06

Xilinx FPGA认证工程师

AMD Xilinx

2024-11

获奖经历

全国大学生集成电路创新创业大赛二等奖

中国半导体行业协会

2025-08

作为队长带领团队完成物联网节点芯片设计,负责核心验证环节。

研究生国家奖学金

教育部

2024-10

表彰在科研创新与学业成绩方面的突出表现。

优秀毕业生

西安电子科技大学

2023-06

本科期间综合测评排名专业前5%。

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